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-- Copyright (C) 1991-2011 Altera Corporation
-- Your use of Altera Corporation's design tools, logic functions
-- and other software and tools, and its AMPP partner logic
-- functions, and any output files from any of the foregoing
-- (including device programming or simulation files), and any
-- associated documentation or information are expressly subject
-- to the terms and conditions of the Altera Program License
-- Subscription Agreement, Altera MegaCore Function License
-- Agreement, or other applicable license agreement, including,
-- without limitation, that your use is for the sole purpose of
-- programming logic devices manufactured by Altera and sold by
-- Altera or its authorized distributors. Please refer to the
-- applicable agreement for further details.
--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- DNU : Do Not Use. This pin MUST NOT be connected.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- Bank 5: 3.3V
-- Bank 6: 3.3V
-- Bank 7: 3.3V
-- Bank 8: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. Connect each pin marked GND* directly to GND
-- or leave it unconnected.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
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-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II Version 11.0 Build 208 07/03/2011 Service Pack 1 SJ Web Edition
CHIP "mz80c" ASSIGNED TO AN: EP3C16F484C6
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND : A1 : gnd : : : :
VCCIO8 : A2 : power : : 3.3V : 8 :
DRAM_ADDR[1] : A3 : output : 3.3-V LVTTL : : 8 : Y
DRAM_BA_1 : A4 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[4] : A5 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[7] : A6 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[11] : A7 : output : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[8] : A8 : bidir : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[10] : A9 : bidir : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[13] : A10 : bidir : 3.3-V LVTTL : : 8 : Y
GND+ : A11 : : : : 8 :
GND+ : A12 : : : : 7 :
HEX1_D[0] : A13 : output : 3.3-V LVTTL : : 7 : Y
HEX1_D[3] : A14 : output : 3.3-V LVTTL : : 7 : Y
HEX1_D[6] : A15 : output : 3.3-V LVTTL : : 7 : Y
HEX2_D[1] : A16 : output : 3.3-V LVTTL : : 7 : Y
HEX2_D[4] : A17 : output : 3.3-V LVTTL : : 7 : Y
HEX2_DP : A18 : output : 3.3-V LVTTL : : 7 : Y
HEX3_D[2] : A19 : output : 3.3-V LVTTL : : 7 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : A20 : : : : 7 :
VCCIO7 : A21 : power : : 3.3V : 7 :
GND : A22 : gnd : : : :
FL_BYTE_N : AA1 : output : 3.3-V LVTTL : : 2 : Y
FL_ADDR[16] : AA2 : output : 3.3-V LVTTL : : 2 : Y
GPIO0_CLKOUT[1] : AA3 : output : 3.3-V LVTTL : : 3 : Y
GPIO0_D[15] : AA4 : output : 3.3-V LVTTL : : 3 : Y
GPIO0_D[13] : AA5 : output : 3.3-V LVTTL : : 3 : Y
VCCIO3 : AA6 : power : : 3.3V : 3 :
GPIO1_D[16] : AA7 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO0_D[11] : AA8 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[15] : AA9 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO0_D[9] : AA10 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_CLKIN[1] : AA11 : input : 3.3-V LVTTL : : 3 : Y
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GPIO0_D[7] : AA13 : output : 3.3-V LVTTL : : 4 : Y
GPIO0_D[4] : AA14 : output : 3.3-V LVTTL : : 4 : Y
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GPIO1_D[0] : AA20 : bidir : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : AA21 : : : : 5 :
SD_DAT0 : AA22 : bidir : 3.3-V LVTTL : : 5 : Y
GND : AB1 : gnd : : : :
VCCIO3 : AB2 : power : : 3.3V : 3 :
GPIO0_CLKOUT[0] : AB3 : output : 3.3-V LVTTL : : 3 : Y
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GPIO0_D[12] : AB5 : output : 3.3-V LVTTL : : 3 : Y
GND : AB6 : gnd : : : :
GPIO1_D[17] : AB7 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO0_D[10] : AB8 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[14] : AB9 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO0_D[8] : AB10 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_CLKIN[0] : AB11 : input : 3.3-V LVTTL : : 3 : Y
GPIO0_CLKIN[0] : AB12 : input : 3.3-V LVTTL : : 4 : Y
GPIO0_D[6] : AB13 : output : 3.3-V LVTTL : : 4 : Y
GPIO0_D[5] : AB14 : output : 3.3-V LVTTL : : 4 : Y
GPIO0_D[3] : AB15 : output : 3.3-V LVTTL : : 4 : Y
GPIO0_D[0] : AB16 : output : 3.3-V LVTTL : : 4 : Y
GPIO1_D[7] : AB17 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO1_D[4] : AB18 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO1_D[3] : AB19 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO1_D[1] : AB20 : bidir : 3.3-V LVTTL : : 4 : Y
VCCIO4 : AB21 : power : : 3.3V : 4 :
GND : AB22 : gnd : : : :
LEDG[9] : B1 : output : 3.3-V LVTTL : : 1 : Y
LEDG[8] : B2 : output : 3.3-V LVTTL : : 1 : Y
DRAM_ADDR[2] : B3 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[10] : B4 : output : 3.3-V LVTTL : : 8 : Y
DRAM_BA_0 : B5 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[6] : B6 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[9] : B7 : output : 3.3-V LVTTL : : 8 : Y
DRAM_UDQM : B8 : output : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[9] : B9 : bidir : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[12] : B10 : bidir : 3.3-V LVTTL : : 8 : Y
GND+ : B11 : : : : 8 :
CLOCK_50_2 : B12 : input : 3.3-V LVTTL : : 7 : Y
HEX1_D[1] : B13 : output : 3.3-V LVTTL : : 7 : Y
HEX1_D[4] : B14 : output : 3.3-V LVTTL : : 7 : Y
HEX1_DP : B15 : output : 3.3-V LVTTL : : 7 : Y
HEX2_D[2] : B16 : output : 3.3-V LVTTL : : 7 : Y
HEX2_D[5] : B17 : output : 3.3-V LVTTL : : 7 : Y
HEX3_D[0] : B18 : output : 3.3-V LVTTL : : 7 : Y
HEX3_D[3] : B19 : output : 3.3-V LVTTL : : 7 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : B20 : : : : 7 :
LCD_DATA[5] : B21 : output : 3.3-V LVTTL : : 6 : Y
LCD_DATA[4] : B22 : output : 3.3-V LVTTL : : 6 : Y
LEDG[6] : C1 : output : 3.3-V LVTTL : : 1 : Y
LEDG[7] : C2 : output : 3.3-V LVTTL : : 1 : Y
DRAM_ADDR[3] : C3 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[0] : C4 : output : 3.3-V LVTTL : : 8 : Y
GND : C5 : gnd : : : :
DRAM_ADDR[5] : C6 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[8] : C7 : output : 3.3-V LVTTL : : 8 : Y
DRAM_ADDR[12] : C8 : output : 3.3-V LVTTL : : 8 : Y
GND : C9 : gnd : : : :
DRAM_DQ[11] : C10 : bidir : 3.3-V LVTTL : : 8 : Y
GND : C11 : gnd : : : :
GND : C12 : gnd : : : :
HEX1_D[2] : C13 : output : 3.3-V LVTTL : : 7 : Y
GND : C14 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : C15 : : : : 7 :
GND : C16 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : C17 : : : : 7 :
GND : C18 : gnd : : : :
HEX3_D[4] : C19 : output : 3.3-V LVTTL : : 7 : Y
LCD_DATA[7] : C20 : output : 3.3-V LVTTL : : 6 : Y
LCD_DATA[3] : C21 : output : 3.3-V LVTTL : : 6 : Y
LCD_DATA[2] : C22 : output : 3.3-V LVTTL : : 6 : Y
~ALTERA_ASDO_DATA1~ / RESERVED_INPUT_WITH_WEAK_PULLUP : D1 : input : 3.3-V LVTTL : : 1 : N
SW[9] : D2 : input : 3.3-V LVTTL : : 1 : Y
GND : D3 : gnd : : : :
VCCIO1 : D4 : power : : 3.3V : 1 :
VCCIO8 : D5 : power : : 3.3V : 8 :
DRAM_WE_N : D6 : output : 3.3-V LVTTL : : 8 : Y
GND : D7 : gnd : : : :
GND : D8 : gnd : : : :
VCCIO8 : D9 : power : : 3.3V : 8 :
DRAM_DQ[0] : D10 : bidir : 3.3-V LVTTL : : 8 : Y
VCCIO8 : D11 : power : : 3.3V : 8 :
VCCIO7 : D12 : power : : 3.3V : 7 :
HEX0_DP : D13 : output : 3.3-V LVTTL : : 7 : Y
VCCIO7 : D14 : power : : 3.3V : 7 :
HEX2_D[0] : D15 : output : 3.3-V LVTTL : : 7 : Y
VCCIO7 : D16 : power : : 3.3V : 7 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D17 : : : : 7 :
VCCIO7 : D18 : power : : 3.3V : 7 :
HEX3_D[5] : D19 : output : 3.3-V LVTTL : : 7 : Y
LCD_DATA[6] : D20 : output : 3.3-V LVTTL : : 6 : Y
LCD_DATA[1] : D21 : output : 3.3-V LVTTL : : 6 : Y
LCD_DATA[0] : D22 : output : 3.3-V LVTTL : : 6 : Y
LEDG[5] : E1 : output : 3.3-V LVTTL : : 1 : Y
~ALTERA_FLASH_nCE_nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : E2 : input : 3.3-V LVTTL : : 1 : N
SW[7] : E3 : input : 3.3-V LVTTL : : 1 : Y
SW[8] : E4 : input : 3.3-V LVTTL : : 1 : Y
DRAM_CLK : E5 : output : 3.3-V LVTTL : : 8 : Y
DRAM_CKE : E6 : output : 3.3-V LVTTL : : 8 : Y
DRAM_LDQM : E7 : output : 3.3-V LVTTL : : 8 : Y
VCCIO8 : E8 : power : : 3.3V : 8 :
DRAM_DQ[3] : E9 : bidir : 3.3-V LVTTL : : 8 : Y
DRAM_DQ[14] : E10 : bidir : 3.3-V LVTTL : : 8 : Y
HEX0_D[0] : E11 : output : 3.3-V LVTTL : : 7 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : E12 : : : : 7 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E13 : : : : 7 :
HEX1_D[5] : E14 : output : 3.3-V LVTTL : : 7 : Y
HEX2_D[3] : E15 : output : 3.3-V LVTTL : : 7 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : E16 : : : : 7 :
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GND : M11 : gnd : : : :
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FL_ADDR[10] : N1 : output : 3.3-V LVTTL : : 2 : Y
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VCCINT : N9 : power : : 1.2V : :
GND : N10 : gnd : : : :
GND : N11 : gnd : : : :
GND : N12 : gnd : : : :
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FL_ADDR[19] : P1 : output : 3.3-V LVTTL : : 2 : Y
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VCCINT : P10 : power : : 1.2V : :
VCCINT : P11 : power : : 1.2V : :
VCCINT : P12 : power : : 1.2V : :
VCCINT : P13 : power : : 1.2V : :
RESERVED_INPUT_WITH_WEAK_PULLUP : P14 : : : : 5 :
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VCCIO5 : P18 : power : : 3.3V : 5 :
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RESERVED_INPUT_WITH_WEAK_PULLUP : P20 : : : : 5 :
PS2_KBDAT : P21 : input : 3.3-V LVTTL : : 5 : Y
PS2_KBCLK : P22 : input : 3.3-V LVTTL : : 5 : Y
FL_RST_N : R1 : output : 3.3-V LVTTL : : 2 : Y
FL_ADDR[21] : R2 : output : 3.3-V LVTTL : : 2 : Y
GND : R3 : gnd : : : :
VCCIO2 : R4 : power : : 3.3V : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : R5 : : : : 2 :
FL_OE_N : R6 : output : 3.3-V LVTTL : : 2 : Y
FL_DQ[0] : R7 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[2] : R8 : bidir : 3.3-V LVTTL : : 2 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : R9 : : : : 3 :
GPIO0_D[22] : R10 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[22] : R11 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO1_D[23] : R12 : bidir : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : R13 : : : : 4 :
GPIO1_D[19] : R14 : bidir : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : R15 : : : : 4 :
GPIO1_CLKOUT[0] : R16 : output : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : R17 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : R18 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : R19 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : R20 : : : : 5 :
PS2_MSCLK : R21 : input : 3.3-V LVTTL : : 5 : Y
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GND+ : T1 : : : : 2 :
GND+ : T2 : : : : 2 :
FL_WP_N : T3 : output : 3.3-V LVTTL : : 2 : Y
FL_DQ[10] : T4 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[8] : T5 : bidir : 3.3-V LVTTL : : 2 : Y
VCCA1 : T6 : power : : 2.5V : :
FL_DQ[9] : T7 : bidir : 3.3-V LVTTL : : 2 : Y
GPIO0_D[26] : T8 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[27] : T9 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO1_D[25] : T10 : bidir : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : T11 : : : : 3 :
GPIO1_D[21] : T12 : bidir : 3.3-V LVTTL : : 4 : Y
VCCINT : T13 : power : : 1.2V : :
GPIO1_D[18] : T14 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO1_D[11] : T15 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO1_CLKOUT[1] : T16 : output : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : T17 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : T18 : : : : 5 :
VCCIO5 : T19 : power : : 3.3V : 5 :
GND : T20 : gnd : : : :
GND+ : T21 : : : : 5 :
GND+ : T22 : : : : 5 :
FL_DQ[3] : U1 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[11] : U2 : bidir : 3.3-V LVTTL : : 2 : Y
GND : U3 : gnd : : : :
VCCIO2 : U4 : power : : 3.3V : 2 :
GNDA1 : U5 : gnd : : : :
VCCD_PLL1 : U6 : power : : 1.2V : :
GPIO0_D[31] : U7 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[29] : U8 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO1_D[26] : U9 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO1_D[24] : U10 : bidir : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : U11 : : : : 3 :
GPIO1_D[20] : U12 : bidir : 3.3-V LVTTL : : 4 : Y
GPIO0_D[20] : U13 : output : 3.3-V LVTTL : : 4 : Y
GPIO0_D[17] : U14 : output : 3.3-V LVTTL : : 4 : Y
GPIO1_D[10] : U15 : bidir : 3.3-V LVTTL : : 4 : Y
VCCINT : U16 : power : : 1.2V : :
VCCINT : U17 : power : : 1.2V : :
VCCA4 : U18 : power : : 2.5V : :
RESERVED_INPUT_WITH_WEAK_PULLUP : U19 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : U20 : : : : 5 :
UART_TXD : U21 : output : 3.3-V LVTTL : : 5 : Y
UART_RXD : U22 : input : 3.3-V LVTTL : : 5 : Y
FL_DQ[12] : V1 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[4] : V2 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[5] : V3 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[13] : V4 : bidir : 3.3-V LVTTL : : 2 : Y
GPIO0_D[30] : V5 : output : 3.3-V LVTTL : : 3 : Y
GPIO1_D[30] : V6 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO1_D[31] : V7 : bidir : 3.3-V LVTTL : : 3 : Y
GPIO0_D[27] : V8 : output : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : V9 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : V10 : : : : 3 :
GPIO0_D[23] : V11 : output : 3.3-V LVTTL : : 3 : Y
GPIO0_D[21] : V12 : output : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : V13 : : : : 4 :
GPIO0_D[16] : V14 : output : 3.3-V LVTTL : : 4 : Y
GPIO1_D[13] : V15 : bidir : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : V16 : : : : 4 :
VCCD_PLL4 : V17 : power : : 1.2V : :
GNDA4 : V18 : gnd : : : :
VCCIO5 : V19 : power : : 3.3V : 5 :
GND : V20 : gnd : : : :
UART_CTS : V21 : input : 3.3-V LVTTL : : 5 : Y
UART_RTS : V22 : output : 3.3-V LVTTL : : 5 : Y
FL_DQ[6] : W1 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[14] : W2 : bidir : 3.3-V LVTTL : : 2 : Y
GND : W3 : gnd : : : :
VCCIO2 : W4 : power : : 3.3V : 2 :
VCCIO3 : W5 : power : : 3.3V : 3 :
GPIO0_D[29] : W6 : output : 3.3-V LVTTL : : 3 : Y
GPIO0_D[28] : W7 : output : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : W8 : : : : 3 :
VCCIO3 : W9 : power : : 3.3V : 3 :
GPIO0_D[25] : W10 : output : 3.3-V LVTTL : : 3 : Y
VCCIO3 : W11 : power : : 3.3V : 3 :
VCCIO4 : W12 : power : : 3.3V : 4 :
GPIO0_D[19] : W13 : output : 3.3-V LVTTL : : 4 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : W14 : : : : 4 :
GPIO1_D[12] : W15 : bidir : 3.3-V LVTTL : : 4 : Y
VCCIO4 : W16 : power : : 3.3V : 4 :
GPIO1_D[9] : W17 : bidir : 3.3-V LVTTL : : 4 : Y
VCCIO4 : W18 : power : : 3.3V : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : W19 : : : : 5 :
SD_WP_N : W20 : input : 3.3-V LVTTL : : 5 : Y
SD_DAT3 : W21 : bidir : 3.3-V LVTTL : : 5 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : W22 : : : : 5 :
FL_DQ[7] : Y1 : bidir : 3.3-V LVTTL : : 2 : Y
FL_DQ[15] : Y2 : bidir : 3.3-V LVTTL : : 2 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : Y3 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : Y4 : : : : 3 :
GND : Y5 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : Y6 : : : : 3 :
GPIO1_D[28] : Y7 : bidir : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : Y8 : : : : 3 :
GND : Y9 : gnd : : : :
GPIO0_D[24] : Y10 : output : 3.3-V LVTTL : : 3 : Y
GND : Y11 : gnd : : : :
GND : Y12 : gnd : : : :
GPIO0_D[18] : Y13 : output : 3.3-V LVTTL : : 4 : Y
VCCIO4 : Y14 : power : : 3.3V : 4 :
GND : Y15 : gnd : : : :
GND : Y16 : gnd : : : :
GPIO1_D[8] : Y17 : bidir : 3.3-V LVTTL : : 4 : Y
GND : Y18 : gnd : : : :
VCCIO5 : Y19 : power : : 3.3V : 5 :
GND : Y20 : gnd : : : :
SD_CLK : Y21 : output : 3.3-V LVTTL : : 5 : Y
SD_CMD : Y22 : output : 3.3-V LVTTL : : 5 : Y