GitHub - 1191000606/HIT-DigitalLogic: 2020年秋哈尔滨工业大学数字逻辑实验，大作业

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2020年秋哈尔滨工业大学数字逻辑实验，大作业

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3人表决器设计代码.png		3人表决器设计代码.png
三人表决器.png		三人表决器.png
三人表决器——打印版.png		三人表决器——打印版.png
三人表决器逻辑图.png		三人表决器逻辑图.png
仿真文件.png		仿真文件.png
全加器波形图.png		全加器波形图.png
全加器波形图——打印版.png		全加器波形图——打印版.png
全加器逻辑图.png		全加器逻辑图.png
全加器逻辑图1.png		全加器逻辑图1.png
八选一数据选择器.png		八选一数据选择器.png
半加器.png		半加器.png
基于FPGA的硬件加速算法.pptx		基于FPGA的硬件加速算法.pptx
大作业-解压后导入vivado.zip		大作业-解压后导入vivado.zip
屏幕截图 2020-11-28 123334.png		屏幕截图 2020-11-28 123334.png
屏幕截图 2020-11-28 123406.png		屏幕截图 2020-11-28 123406.png
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屏幕截图 2020-11-28 130713.png		屏幕截图 2020-11-28 130713.png
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屏幕截图 2020-11-28 132603.png		屏幕截图 2020-11-28 132603.png
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屏幕截图 2020-11-28 132936.png		屏幕截图 2020-11-28 132936.png
数字逻辑大作业.docx		数字逻辑大作业.docx