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8bitbrain.pin
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-- Copyright (C) 1991-2009 Altera Corporation
-- Your use of Altera Corporation's design tools, logic functions
-- and other software and tools, and its AMPP partner logic
-- functions, and any output files from any of the foregoing
-- (including device programming or simulation files), and any
-- associated documentation or information are expressly subject
-- to the terms and conditions of the Altera Program License
-- Subscription Agreement, Altera MegaCore Function License
-- Agreement, or other applicable license agreement, including,
-- without limitation, that your use is for the sole purpose of
-- programming logic devices manufactured by Altera and sold by
-- Altera or its authorized distributors. Please refer to the
-- applicable agreement for further details.
--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- DNU : Do Not Use. This pin MUST NOT be connected.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. For transceiver I/O banks (Bank 13, 14, 15, 16 and 17),
-- connect each pin marked GND* either individually through a 10k Ohm resistor
-- to GND or tie all pins together and connect through a single 10k Ohm resistor
-- to GND.
-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND
-- or leave it unconnected.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
---------------------------------------------------------------------------------
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-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II Version 9.0 Build 235 06/17/2009 Service Pack 2 SJ Web Edition
CHIP "8bitbrain" ASSIGNED TO AN: EP2C8T144C8
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : 1 : input : 3.3-V LVTTL : : 1 : Y
~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : 2 : input : 3.3-V LVTTL : : 1 : Y
GND* : 3 : : : : 1 :
GND* : 4 : : : : 1 :
VCCIO1 : 5 : power : : 3.3V : 1 :
GND : 6 : gnd : : : :
save : 7 : input : 3.3-V LVTTL : : 1 : Y
arpmodein : 8 : input : 3.3-V LVTTL : : 1 : Y
GND* : 9 : : : : 1 :
altera_reserved_tdo : 10 : output : 3.3-V LVTTL : : 1 : Y
altera_reserved_tms : 11 : input : 3.3-V LVTTL : : 1 : Y
altera_reserved_tck : 12 : input : 3.3-V LVTTL : : 1 : Y
altera_reserved_tdi : 13 : input : 3.3-V LVTTL : : 1 : Y
DATA0 : 14 : input : : : 1 :
DCLK : 15 : : : : 1 :
nCE : 16 : : : : 1 :
clk : 17 : input : 3.3-V LVTTL : : 1 : Y
data_in[1] : 18 : input : 3.3-V LVTTL : : 1 : N
GND : 19 : gnd : : : :
nCONFIG : 20 : : : : 1 :
data_in[0] : 21 : input : 3.3-V LVTTL : : 1 : N
btn_vec[0] : 22 : input : 3.3-V LVTTL : : 1 : N
VCCIO1 : 23 : power : : 3.3V : 1 :
reset : 24 : input : 3.3-V LVTTL : : 1 : Y
LDISPa : 25 : output : 3.3-V LVTTL : : 1 : Y
VCCINT : 26 : power : : 1.2V : :
GND : 27 : gnd : : : :
LDISPb : 28 : output : 3.3-V LVTTL : : 1 : Y
VCCIO1 : 29 : power : : 3.3V : 1 :
LDISPc : 30 : output : 3.3-V LVTTL : : 1 : Y
LDISPd : 31 : output : 3.3-V LVTTL : : 1 : Y
LDISPe : 32 : output : 3.3-V LVTTL : : 1 : Y
GND : 33 : gnd : : : :
GND_PLL1 : 34 : gnd : : : :
VCCD_PLL1 : 35 : power : : 1.2V : :
GND_PLL1 : 36 : gnd : : : :
VCCA_PLL1 : 37 : power : : 1.2V : :
GNDA_PLL1 : 38 : gnd : : : :
GND : 39 : gnd : : : :
LDISPf : 40 : output : 3.3-V LVTTL : : 4 : Y
LDISPg : 41 : output : 3.3-V LVTTL : : 4 : Y
GND* : 42 : : : : 4 :
data_in[4] : 43 : input : 3.3-V LVTTL : : 4 : N
data_in[2] : 44 : input : 3.3-V LVTTL : : 4 : N
GND* : 45 : : : : 4 :
VCCIO4 : 46 : power : : 3.3V : 4 :
GND* : 47 : : : : 4 :
GND* : 48 : : : : 4 :
GND : 49 : gnd : : : :
VCCINT : 50 : power : : 1.2V : :
GND* : 51 : : : : 4 :
GND* : 52 : : : : 4 :
btn_vec[1] : 53 : input : 3.3-V LVTTL : : 4 : Y
VCCIO4 : 54 : power : : 3.3V : 4 :
btn_vec[2] : 55 : input : 3.3-V LVTTL : : 4 : Y
GND : 56 : gnd : : : :
btn_vec[3] : 57 : input : 3.3-V LVTTL : : 4 : Y
btn_vec[4] : 58 : input : 3.3-V LVTTL : : 4 : Y
btn_vec[5] : 59 : input : 3.3-V LVTTL : : 4 : Y
btn_vec[6] : 60 : input : 3.3-V LVTTL : : 4 : Y
GND : 61 : gnd : : : :
VCCINT : 62 : power : : 1.2V : :
data_in[5] : 63 : input : 3.3-V LVTTL : : 4 : Y
data_in[7] : 64 : input : 3.3-V LVTTL : : 4 : Y
data_in[8] : 65 : input : 3.3-V LVTTL : : 4 : Y
VCCIO4 : 66 : power : : 3.3V : 4 :
data_in[6] : 67 : input : 3.3-V LVTTL : : 4 : Y
GND : 68 : gnd : : : :
data_in[9] : 69 : input : 3.3-V LVTTL : : 4 : Y
s2p_ioclk : 70 : output : 3.3-V LVTTL : : 4 : Y
s2p_cs : 71 : output : 3.3-V LVTTL : : 4 : Y
GND* : 72 : : : : 4 :
GND* : 73 : : : : 3 :
GND* : 74 : : : : 3 :
GND* : 75 : : : : 3 :
~LVDS54p/nCEO~ : 76 : output : 3.3-V LVTTL : : 3 : Y
VCCIO3 : 77 : power : : 3.3V : 3 :
GND : 78 : gnd : : : :
GND* : 79 : : : : 3 :
GND : 80 : gnd : : : :
VCCINT : 81 : power : : 1.2V : :
nSTATUS : 82 : : : : 3 :
CONF_DONE : 83 : : : : 3 :
MSEL1 : 84 : : : : 3 :
MSEL0 : 85 : : : : 3 :
p2s_ld : 86 : output : 3.3-V LVTTL : : 3 : Y
LDISPa10 : 87 : output : 3.3-V LVTTL : : 3 : Y
GND+ : 88 : : : : 3 :
GND+ : 89 : : : : 3 :
GND+ : 90 : : : : 3 :
GND+ : 91 : : : : 3 :
LDISPb11 : 92 : output : 3.3-V LVTTL : : 3 : Y
LDISPc12 : 93 : output : 3.3-V LVTTL : : 3 : Y
LDISPd13 : 94 : output : 3.3-V LVTTL : : 3 : Y
VCCIO3 : 95 : power : : 3.3V : 3 :
LDISPe14 : 96 : output : 3.3-V LVTTL : : 3 : Y
LDISPf15 : 97 : output : 3.3-V LVTTL : : 3 : Y
GND : 98 : gnd : : : :
LDISPg16 : 99 : output : 3.3-V LVTTL : : 3 : Y
GND* : 100 : : : : 3 :
GND* : 101 : : : : 3 :
VCCIO3 : 102 : power : : 3.3V : 3 :
GND* : 103 : : : : 3 :
GND* : 104 : : : : 3 :
GND : 105 : gnd : : : :
GND_PLL2 : 106 : gnd : : : :
VCCD_PLL2 : 107 : power : : 1.2V : :
GND_PLL2 : 108 : gnd : : : :
VCCA_PLL2 : 109 : power : : 1.2V : :
GNDA_PLL2 : 110 : gnd : : : :
GND : 111 : gnd : : : :
edit_change_rot[0] : 112 : input : 3.3-V LVTTL : : 2 : Y
edit_change_rot[1] : 113 : input : 3.3-V LVTTL : : 2 : Y
edit_select_rot[0] : 114 : input : 3.3-V LVTTL : : 2 : Y
edit_select_rot[1] : 115 : input : 3.3-V LVTTL : : 2 : Y
VCCIO2 : 116 : power : : 3.3V : 2 :
GND : 117 : gnd : : : :
waveform_rot[0] : 118 : input : 3.3-V LVTTL : : 2 : Y
waveform_rot[1] : 119 : input : 3.3-V LVTTL : : 2 : Y
wave_bank_rot[0] : 120 : input : 3.3-V LVTTL : : 2 : Y
wave_bank_rot[1] : 121 : input : 3.3-V LVTTL : : 2 : Y
RDISPa : 122 : output : 3.3-V LVTTL : : 2 : Y
GND : 123 : gnd : : : :
VCCINT : 124 : power : : 1.2V : :
RDISPb : 125 : output : 3.3-V LVTTL : : 2 : Y
RDISPc : 126 : output : 3.3-V LVTTL : : 2 : Y
VCCIO2 : 127 : power : : 3.3V : 2 :
GND : 128 : gnd : : : :
RDISPd : 129 : output : 3.3-V LVTTL : : 2 : Y
GND : 130 : gnd : : : :
VCCINT : 131 : power : : 1.2V : :
RDISPe : 132 : output : 3.3-V LVTTL : : 2 : Y
RDISPf : 133 : output : 3.3-V LVTTL : : 2 : Y
RDISPg : 134 : output : 3.3-V LVTTL : : 2 : Y
GND* : 135 : : : : 2 :
p2s_cs : 136 : output : 3.3-V LVTTL : : 2 : Y
p2s_ioclk : 137 : output : 3.3-V LVTTL : : 2 : Y
VCCIO2 : 138 : power : : 3.3V : 2 :
p2s_dout : 139 : output : 3.3-V LVTTL : : 2 : Y
GND : 140 : gnd : : : :
GND* : 141 : : : : 2 :
data_in[3] : 142 : input : 3.3-V LVTTL : : 2 : N
GND* : 143 : : : : 2 :
GND* : 144 : : : : 2 :