Emphasize conflict between initial and always_ff

docs/hdl-by-example/coding_standard.md

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 设置启动初始值不能代替复位的功能，不能偷懒，必须都实现。不可以对组合逻辑使用。
 
+特别地，对于 System Verilog，对同一个寄存器在 initial 和 always_ff 中分别赋值会报错，此时可以把 always_ff 改成 always。
+
 === "System Verilog"
 
     ```sv
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       some_reg = 1'b0;
     end
 
-    // GOOD
+    // GOOD, but do not use with always_ff
     logic some_reg;
     initial some_reg = 1'b0;