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unary‐mod4
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- Ficha: Contador unario módulo 4
- Descargas
- Descripción
- Ruta de datos y control
- Evolución del estado
- Diagrama de estado
- Cronograma
- Medición con el analizador lógico
- Ciclo de trabajo
- Visualización en los LEDs
- Recursos
- Conceptos nuevos
- Enlaces
- Autor
- Licencia
- Circuito Icestudio: unary-mod4.ice
- Ficha circuito: (SVG) (PDF) (PNG)
Este circuito es la extensión del contador unary-mod3 a 3 marcas, que cuenta repetidamente desde 0 a 3 en unario. Como es un contador módulo 4, sólo se necesitan 3 biestables (uno para cada marca)
Es similar a la del circuito unary-mod3, pero con un bit adicional
La cuenta empieza en el Ciclo 0, y se repite periódicamente cada 4 ciclos de reloj: 000, 100, 110 y 111
El diagrama de estados es cíclico, porque es un contador módulo 4. Al llegar a la cuenta máxima se retorna al estado inicial (en el siguiente ciclo de reloj)
Se observa cómo las 3 señales que salen del estado son periódicas

Al ser un contador módulo 4, el periodo es 4. El ciclo de trabajo de las diferentes señales es de 3/4, 2/4 y 1/4. Que se corresponde con los porcentajes 75%, 50% y 25%
Al probar el circuito, los LEDs 7, 6 y 5 se encienden. Se corresponden con las señales del contador unario b2, b1 y b0. Nuestro ojo NO aprecia ningún parpadeo, sino que los ves como si estuviesen encendidos (porque la frecuencia es muy alta)
Los LEDs utilizado en la placa AP-LED8 son muy eficientes y con muy poca energía lucen casi a tope, por lo que apenas se nota diferencia con los ojos (y en la foto se aprecia menos todavía)
Si los LEDs que encendemos son los verdes (LED0, LED1 y LED2), sí que se aprecia ligeramente con los ojos (aunque en la foto no se aprecia tan bien como en real)
| Recurso | Cantidad | Máximo | Descripcioin |
|---|---|---|---|
| LC | 5 | 7680 | Celdas lógicas |
| IO | 4 | 256 | Bloques de E/S |
No hay conceptos nuevos en este circuito. Es una extensión del contador unario módulo 3, de 2 marcas
- iceGates: Colección de Icestudio con puertas lógicas
- Colección iceFF: Colección para Icestudio. Biestables
- Cuaderno ténico CT18 de FPGAs Libres: Fundamentos. Sistema unario
- Juan González-Gómez (Obijuan)
- shift
- shift-reg2
- sreg-02-sys-sr-basic🟡
- sreg-concat-left
- sreg-concat-right
- concat-sysdff-sreg2
- concat-sreg2-sysdff
- sreg-03-sys-sr-basic🟡
- concat-sreg2-sreg2
- sreg-04-sys-sr-basic🟡
- unary-ii🔵
- unary-iii
- unary-n🔴
- unary-ii-timer
- unary-ii-timer-bmax
- unary-iii-timer
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- sreg-unary-iii-timer
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- sreg-unary-n-timer
- unary-ii-wait🔵
- unary-ii-wait2🔵
- unary-ii-wait2-simp
- unary-ii-rst
- unary-iii-rst
- unary-mod3🔵
- unary-mod4
- unary-modn
- unary-mod2🔵
- unary-prescaler1:2
- unary-prescaler1:2-ini
- unary-prescaler1:3
- unary-prescaler1:4
- unary-prescaler1:n
- heart-prescaler1:2🟡
🚧 TODO 🚧
- 🟡: Nuevo bloque introducido
- 🔵: Circuito importante
- 🔴: Presentación de limitaciones y retos a superar